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| 專利名稱(英) | Circuit re-synthesis and method for delay variation tolerance |
| 專利家族 |
中華民國：I272771 美國：7,224,178 |
| 專利權人 | 國立清華大學 100.00% |
| 發明人 | 張世杰 |
| 技術領域 | 電子電機 |
 專利摘要(中) |
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| By adding redundant logic gates into a circuit without changing function of the whole circuit, the present invention can tolerate certain delay variations. The present invention can be applied in the IC industries to improve the yield in semiconductor manufacturing. |
 聯絡資訊 |
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|---|---|
| 承辦人姓名 | 李曉琪 |
| 承辦人電話 | 03-5715131 #31061 |
| 承辦人Email | hsiaochi@mx.nthu.edu.tw |
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